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DMG CPU Inside

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Dmg-cpu-inside

Ce dépôt contient une superposition annotée pour le jeu de puce Nintendo Game Boy DMG-CPU-B et les schémas extraits.

DMG-CPU-B Die Vector superposition

Cela a été fait manuellement avec seulement quelques chèques automatisés , il y a donc un risque élevé d'erreur . Je ne suis en aucun cas responsable si vous avez fait en sorte que la vie de quelqu'un en dépendait et que cela a foutu.

Qu'est-ce qui est fait:

Toutes les logiques APU.
Toute Logic PPU.
Toutes les logiques d'E / S et de minuterie.
Toute la logique DMA.
Toutes les logiques d'interruption.
Diverses choses utilisées pour tester / débogage.

Ce qui n'est pas fait:

CPU. Pourquoi: c'est un noyau autonome qui n'utilise pas la topologie cellulaire standard. La visibilité n'est pas assez bonne et c'est trop complexe pour moi, désolé.
Compléments d'horloge. Pourquoi: ils n'affectent pas les fonctionnalités. Seule requis car les cellules DFF ont besoin d'une horloge et de son complément au travail.
Quelques parties analogiques. Pourquoi: mauvaise visibilité, paresse.
Certains groupes cellulaires liés à des blocs ROM et RAM intégrés. Pourquoi: ils n'affectent pas les fonctionnalités.

Comment utiliser

Il suffit de lire les schémas :)

Si vous souhaitez utiliser la superposition:

Faire un écran
Téléchargez l'image DIE de Digshadow
Redimensionner à 8000px de large si vous utilisez Inkscape 0,92.2, sinon il peut geler
Téléchargez la superposition SVG
Ouvrez la superposition dans Inkscape, importez l'image de la mat
Amusez-vous"

Notes

Les NET nommés FROM_CPU* et TO_CPU sont connectés au noyau du CPU mais ne sont pas clairement identifiés. Beaucoup d'entre eux sont déclencheurs et reconnaissent des signaux pour les interruptions. D'autres peuvent être des indicateurs d'État comme le Z80 / M1 ou Halt.

Certaines polarités d'horloge DFF doivent être vérifiées.

Les registres de décalage parallèle dans la série utilisée pour la liaison série et le rendu vidéo sont faits de chaînes de DFF compatibles à réinstallation. Leur logique de chargement nécessite beaucoup de cellules et semblent complexes, mais à la fin, elle forme quelque chose de assez simple.

Plutôt que d'utiliser des multiplexeurs, de nombreux bus internes sont plutôt capables à trois états. Les cellules "Tribuffer" sont largement utilisées pour cela.

Mystères

Les bit 4 et 5 de FF26 (NR52) peuvent être écrits.
- Le bit 4 définit Net03 (mode de test APU?).
- Le bit 5 permet le blocage des logiciels de la minuterie de balayage CH1 lorsque Net03 est élevé.
Le bit 0 de FF23 (NR44) peut être lu. Il se rapporte au Prescaler CH4.
L'adresse RAM de l'onde actuelle peut être lue en bits 4 ~ 0 de FF1C (NR32) lorsque Net03 est élevé.
La puce entière peut être faite un esclave pour un CPU externe en utilisant les épingles d'essai. Cela a déjà été découvert par @gekkio et peut-être d'autres.
Probablement d'autres choses que j'ai manquées ...

PAQ (questions potentiellement posées)

Pourquoi ?

Il est bien connu par les auteurs d'émulateurs que le Game Boy est plein de bizarreries. Savoir exactement comment et quand les signaux changent peuvent aider à atteindre une précision parfaite.

Pourquoi les schémas ne sont-ils pas dans un format modifiable?

Parce que j'ai utilisé un logiciel de CAO propriétaire pour la vitesse et que je n'ai pas fini de faire le convertisseur pour le format Kicad. J'espère pouvoir le faire bientôt.

Qu'est-ce qui se passe avec les étiquettes de cellules?

Ce sont des noms uniques aléatoires. La première lettre correspond à la colonne dans laquelle ils sont sur la mort du silicium.

Beaucoup de petites lignes ne sont pas tracées, pourquoi?

Je n'ai pas pris la peine de tracer les lignes de ramification lorsque leur point final était assez proche pour le voir sur mon écran de 15 "au niveau du zoom que j'ai utilisé. Ils sont signalés sur le schéma, bien sûr.

Pourquoi y a-t-il des copies de blocs logiques offrant des fonctions identiques?

C'est une façon de compromettre l'espace pour la vitesse, cela semble bizarre mais c'est utile. Recherchez la "duplication logique".

J'ai trouvé une erreur, comment puis-je le signaler?

Jusqu'à ce que je fasse exporter les fichiers au format Kicad, veuillez ouvrir un problème et décrire ce qui ne va pas (nom de la cellule, nom de filet, position sur Die, ...).

Comment saviez-vous quelles cellules ont fait quoi?

J'ai dû faire des suppositions. Les entrées et les sorties sont facilement identifiées et la taille de la cellule donne quelques indices. Lorsque des connexions sont établies sur le schéma, cela devient rapidement évident lorsqu'une supposition est fausse. Découvrez le Zoo Cell.